锁相环(PLL)原理讲解背景知识在通信机等所使用的振荡电路 其所要求的频率范围要广 且频率的稳定度要高 无论多好的 LC 振荡电路 其频率的稳定度 都无法与晶体振荡电路比较 但是 晶体振荡器除了可以使用数字电路分频以外 其频率几乎无法改变 如果采用 PLL 锁相环 相位锁栓回路 PhaseLockedL 技术 除了可以得到较广的振荡频率范围以外 其频率的稳定度也很高 此一技术常使用于收音机 电视机的调谐电路上 以及 CD 唱盘上的电路 PLL phase lockedloop 即锁相环 是 FPGA 中的重要资源 由于一个复
② 低通滤波器（LPF）
此一PD脉波信号经过回路滤波器(LoopFilter)的积分，便可以得到直流电压VR，可以控制VCO电路。
③ 压控振荡器（VCO）
由于控制电压VR的变化，VCO振荡频率会提高。结果使得fr=f0在f与f的相位成为一致时，PD端子会成为高阻抗状态，使PLL(锁相环)被锁栓(Lock)。
④ 分频器（FD）
那么PLL是如何实现倍频的呢？其实就是对输出fo作N分频，即fN,将分频后的频率送入鉴相器中与参考频率进行比较。当PLL进入锁定状态时，输出频率fo就实现了倍频，此时fo=N*fi。
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